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时间偏差的衡量方法。由于信号边沿的时间偏差可能是由于各种因素造成的，有随机的噪声，还有确定性的干扰。所以这个时间偏差通常不是一个恒定值，而是有一定的统计分布，在不同的应用场合这个测量的结果可能是用有效值(RMS)衡量，也可能是用峰-峰值(peak-peak)衡量，更复杂的场合还会对这个时间偏差的各个成分进行分解和估计。因此抖动的精确测量需要大量的样本以及复杂的算法。对抖动进行衡量和测量时，需要特别注意的是，即使对于同一个信号，如果用不同的方法进行衡量，得到的抖动测量结果也可能不一样，下面是几种常用的抖动测量项目。数字信号上升时间是示波器中进行上升时间测量例子，光标交叉点指示出上升时间测量的起始点和结束点的位置；测试服务数字信号测试销售

数字信号的时域和频域

数字信号的频率分量可以通过从时域到频域的转换中得到。首先我们要知道时域是真实世界，频域是更好的用于做信号分析的一种数学手段，时域的数字信号可以通过傅里叶变换转变为一个个频率点的正弦波的。这些正弦波就是对应的数字信号的频率分量。假如定义理想方波的边沿时间为0,占空比50%的周期信号，其在傅里叶变换后各频率分量振幅。

可见对于理想方波，其振幅频谱对应的正弦波频率是基频的奇数倍频(在50%的占空比下)。奇次谐波的幅度是按1"下降的(/是频率)，也就是-20dB/dec(-20分贝每十倍频)。 测试服务数字信号测试销售数字信号的建立/保持时间（Setup/Hold Time）;

通常情况下预加重技术使用在信号的发送端，通过预先对信号的高频分量进行增强来 补偿传输通道的损耗。预加重技术由于实现起来相对简单，所以在很多数据速率超过 1Gbps 的总线中使用，比如PCle,SATA 、USB3 .0 、Displayport等总线中都有使用。当 信号速率进一步提高以后，传输通道的高频损耗更加严重，靠发送端的预加重已经不太 够用，所以很多高速总线除了对预加重的阶数进一步提高以外，还会在接收端采用复杂的均 衡技术，比如PCle3.0 、SATA Gen3 、USB3.0 、Displayport HBR2 、10GBase-KR等总线中都 在接收端采用了均衡技术。采用了这些技术后，FR-4等传统廉价的电路板材料也可以应用 于高速的数字信号传输中，从而节约了系统实现的成本。

需要注意的是，采用8b/10b编码方式也是有缺点的，比较大的缺点就是8bit到10bit的编码会造成额外的20%的编码开销，所以很多10Gbps左右或更高速率的总线不再使用8b/10b编码方式。比如PCIe1.0和PCIe2.0的总线速率分别为2.5Gbps和5Gbps,都是采用8b/10b编码，而PCle3.0、PCle4.0、PCle5.0的总线速率分别达到8Gbps、16Gbps和32Gbps,并通过效率更高的128b/130b的编码结合扰码的方法来实现直流平衡和嵌入式时钟。另一个例子是FibreChannel总线，1xFC、2xFC、4xFC、8xFC的数据速率分别为1.0625Gbps、2 . 125Gbps,4 . 25Gbps 、8 . 5Gbps,都是采用8b/10b编码，而16xFC 、32xFC 的数据速率分别  为14.025Gbps和28.05Gbps,采用的是效率更高的64b/66b编码方式。64b/66b编码在 10G和100G以太网中也有广泛应用。数字信号的预加重（Pre-emphasis）;

对于并行总线来说，更致命的是这种总线上通常挂有多个设备，且读写共用，各种信号分叉造成的反射问题使得信号质量进一步恶化。

为了解决并行总线占用尺寸过大且对布线等长要求过于苛刻的问题，随着芯片技术的发展和速度的提升，越来越多的数字接口开始采用串行总线。所谓串行总线，就是并行的数据在总线上不再是并行地传输，而是时分复用在一根或几根线上传输。比如在并行总线上 传输1Byte的数据宽度需要8根线，而如果把这8根线上的信号时分复用在一根线上就可 以减少需要的走线数量，同时也不需要再考虑8根线之间的等长关系。 示波器进行数字信号的幅度测试；测试服务数字信号测试销售

上升时间是数字信号另一个非常关键的参数，它反映了一个数字信号在电平切换时边沿变化的快慢。测试服务数字信号测试销售

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